TRANSFERT PAR BLOC, RECONNAISSANCE D'INTERRUPTION et
CHAPTER 3: CHAPTER 3: VSB DATA TRANSFER BUS ARBITRATION
The most fundamental of the global resources in a multiprocessing system is the Data Transfer Bus through which all other global resources are accessed. Therefore, any system that supports multi- processing needs to provide an efficient allocation method for the Data Transfer Bus. The VSB meets this need with its Arbitration Bus (see Figure 3-1). The protocols of the VSB Arbitration Bus provide for the scheduling of requests for the DTB from multiple MASTERS and its -assignment to only one MASTER at a time.
Fig. 3-1. - Arbitration Bus functional block diagram.
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3.1.1 Types d'arbitrage
Le VSB définit deux méthodes d'arbitrage - une méthode d'arbitrage série et une méthode d'arbitrage parallèle.
Dans la méthode d'arbitrage série, le module DEMANDEUR requiert le bus pour le compte du MAITRE auquel il est associé. Il attend alors que sa demande soit acquittée et que le bus lui soit alloué par l'ARBITRE du système. Le paragraphe 3.4.1 décrit le mécanisme d'arbitrage série.
Dans la méthode d'arbitrage parallèle, le DEMANDEUR associé au MAITRE actif déclenche un cycle d'ARBITRAGE. Tous les DEMANDEURS qui ont une demande en attente participent à ce cycle.
Pendant le cycle d'ARBITRAGE, les DEMANDEURS déterminent le MAITRE qui aura l'autorisation d'utiliser le DTB. Dans la norme VSB, le DEMANDEUR associé au MAITRE actif est appelé DEMANDEUR actif.
Tous les DEMANDEURS qui ont une demande de bus en attente et qui participent à un cycle d'ARBITRAGE sont appelés les DEMANDEURS concurrents. La méthode d'arbitrage parallèle ne requiert pas d'ARBITRE. Le paragraphe 3.4.2 décrit le mécanisme d'arbitrage parallèle.
La méthode d'arbitrage utilisée est sélectionnée dynamiquement pendant la séquence de mise sous tension du sous-système VSB compte tenu des possibilités des DEMANDEURS du système. Le para- graphe 3.4.3 décrit cette séquence de démarrage.
3.2 Lignes d'arbitrage du bus
Les lignes du bus d'arbitrage coordonnent le transfert de la prise de contrôle du bus entre les DEMANDEURS du système. Le bus d'arbi- trage comprend les lignes de commande suivantes:
BREQ* - demande du bus BUSY* - occupation du bus
BG I N* - entrée d'allocation du bus BGOUT* - sortie d'allocation du bus OBSERVATION 3.1:
En plus des lignes de commande ci-dessus, le mécanisme d'arbitrage parallèle utilise certaines lignes du bus de transfert de données ainsi que les lignes d'adressage géographique.
3.2.1 BREQ*
La ligne BREQ* est utilisée par les DEMANDEURS pour demander l'utilisation du DTB. Ils commandent BREQ* au niveau bas en réponse à une requête du DTB de la part de leur MAITRE associé.
3.2.2 BUSY*
La ligne BUSY* est commandée au niveau bas par le DEMANDEUR actif pour informer l'ARBITRE, ainsi que les autres DEMANDEURS, que le contrôle du DTB a été pris par le MAITRE actif.
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3.1 .1 Types of Arbitration
The VSB defines two arbitration methods - a Serial Arbitration method and a Parallel Arbitration method.
In the Serial Arbitration method, a REQUESTER module requests the bus in behalf of its associated MASTER. It then waits for the request to be acknowledged and the bus to be granted by the system ARBITER. Paragraph 3.4.1 describes the Serial Arbitration mechanism.
In the Parallel Arbitration method, the REQUESTER that is associated with the active MASTER initiates an ARBITRATION cycle. All the REQUESTERS that have a request pending participate in the cycle.
During the ARBITRATION cycle, the REQUESTERS determine which MASTER will be granted use of the DTB. The VSB standard calls the REQUESTER that is associated with the active MASTER the active REQUESTER. All REQUESTERS that have a bus request pending and who participate in an ARBITRATION cycle are called contending REQUESTERS. An ARBITER is not required in the Parallel Arbitration method. Paragraph 3.4.2 describes the Parallel Arbitration mechanism.
The arbitration method that is used is dynamically selected during the power-up sequence of the VSB subsystem, depending on the capabilities of the system's REQUESTERS. Paragraph 3.4.3 describes this power-up sequence.
3.2 Arbitration Bus lines
The lines of the Arbitration Bus coordinate the transfer of bus mastership between the system's REQUESTERS. The Arbitration Bus includes the following control lines:
BREQ* - Bus REQuest BUSY* - Bus BUSY BGIN* - Bus Grant IN BGOUT* - Bus Grant OUT OBSERVATION 3.1:
In addition to the above control lines, the Parallel Arbitration mechanism uses some of the Data Transfer Bus lines, as well as the geographical addressing lines.
3.2.1 BREQ*
The BREQ* line is used by REQUESTERS to request use of the DTB.
They drive BREQ* low in response to their associated MASTERS' need for the DTB.
3.2.2 BUSY*
The BUSY* line is driven low by the active REQUESTER to inform the ARBITER, as well as other REQUESTERS, that control of the DTB has been assumed by the active MASTER.
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3.2.3 BGIN*IBGOUT*
Le processus d'arbitrage série requiert une ligne de signal formant une chaợne sộrie. Le signal entrant chaque carte est appelộ "Bus Grant IN" - BGIN*, alors que le signal sortant de chaque carte est appelé "Bus Grant OUT" - BGOUT*. Voir chapitre 5.
L'ARBITRE gộnốre un front descendant sur la chaợne sộrie d'allo- cation du bus pour autoriser l'utilisation du DTB. Ce niveau bas se propage sur la chaợne sộrie. Si un DEMANDEUR a une demande de bus en attente, il ne transfère pas ce niveau bas de son entrée BGIN*
vers sa sortie BGOUT*.. Sinon, il propage le niveau bas en aval sur la chaợne sộrie.
3.3 Modules d'arbitrage - Description générale
Les paragraphes 3.3.1 et 3.3.2 fournissent les schémas-blocs des deux modules définis dans l'arbitrage de bus: ARBITRE et DEMANDEUR.